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good signal (TTL compatible) shall be provided to indicate normal operating
conditions of the power supply. The power good signal will be asserted (low
state) during power up until the +5VDC outputs are within the regulation
range defined in Section 3.2.1 The electrical and timing characteristics of
the power good signal, are shown in Table 7 and Figure1: Power Supply Timing.
PWR_OK should be de-asserted to a low state when any of the +12 VDC, +5 VDC,
or +3.3 VDC output voltages falls below its under voltage threshold, or when
mains power has been removed for a time |
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